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AD9957外部参考时钟

下图为AD9957中文数据手册第4页的表1截图,,则AD9957在使用REF_CLK的时候,工作频率至少为60MHz(REFCLK乘法器禁用时),或3.2*12=38.4MHz(REFCLK乘法器使能时,乘以12是因为数据手册第34页说PLL支持非常宽的可编程倍频系数(12至127倍)),对吗?

其实,我只想让SYS_CLK = 31.5 MHz,可以实现吗?

谢谢!