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时钟与DDS
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ADL5961上电120mA,后面按照上电顺序给电,下发命令没响应。设置IGAIN后回读寄存器为全0,帮忙看看是什么原因?
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27 days ago
AD9528 同步脉冲请求问题
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1 month ago
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1 month ago
DDS AD9910
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1 month ago
ad9528/ad9510测试板
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1 month ago
该专区内容有关时钟与DDS的讨论和常见问题解答。 发帖前请阅读 Analog Devices EngineerZone 行为准则。
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Jesse__S
时钟与DDS
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11 days ago
by
Jesse__S
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使用AD9954/3/2/1的ASF调节输出波形幅值时,会影响DAC的输出位数吗?
+1
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AD9954/ AD9953/AD9952/AD9951 有一个ASF(Amplitude scale factor)的14bit寄存器,可以调节输出波形的幅值,这里的幅值调节是否对AD9954内部14bitDAC的输出位数产生影响,是否还能保证在ASF修改为任意值时,DAC的输出位数都是14bit。如果修改ASF会影响DAC输出位数,那么有没有其他调节输出波形幅值的方法?
ad9954
Datasheet/Specs
clock and timing
dds
Direct Digital Synthesis (DDS)
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SGSD
时钟与DDS
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14 days ago
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YANAMIANNA
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AD9910
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我设计的ad9910电路板,放在机箱中机箱模块5v供电,机箱收到静电时ad9910的输出会归零,通过spi读取寄存器,静电后cfr1,cfr2,cfr3这三个寄存器复位成默认值,其他step,range等寄存器保持不变。重新配置寄存器,ad9910输出恢复,我想知道静电影响了芯片的哪个位置或者引脚让cfr寄存器复位
hardware
clock and timing
Direct Digital Synthesis (DDS)
ad9910
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JimHuang
时钟与DDS
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27 days ago
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ADL5961上电120mA,后面按照上电顺序给电,下发命令没响应。设置IGAIN后回读寄存器为全0,帮忙看看是什么原因?
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ADL5961上电120mA,后面按照上电顺序给电,下发命令没响应。设置IGAIN后回读寄存器为全0,帮忙看看是什么原因?
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wuwuwusan
时钟与DDS
Started
1 month ago
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AD9528 同步脉冲请求问题
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您好 我这里在配置9528时出现了一个问题 。 目前配置方式是通过SPI直接写寄存器地址来完成配置 出现这样一个问题 同步脉冲的触发方式目前为 SPI控制 我这里改写寄存器403的 bit0 是没有同步脉冲发出的?这是什么原因导致的? 测试环节: 1.在初始化配置是 直接将 BIT0 置1 无同步脉冲 2.先将所有寄存器进行配置(本次配置时bit0 为0)然后进行io更新。 更新后,重新配置寄存器403 (本次将bit0置1)然后再次寄存器更新 无同步脉冲
Clock Generation Devices
Clock Generation and Distribution
software
ad9528
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DXXCCN
时钟与DDS
Started
1 month ago
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你好,我使用AD9910进行多片同步,采用ADCLK854进行系统时钟分发差分晶振经过ADCLK854处理的时钟信号,同时采用ADCLK854进行同步的STNC-OUT信号的分发,时钟信号正常,SYNC-OUT输出正常,频率62.5MHz左右,但是接入主片,从片,一直显示无效电平状态,那个同步引脚一直为高,请帮忙提供下技术支持。
hardware
无效SYNC-IN信号
clock and timing
Clocks & Timers
dds
多片同步
Direct Digital Synthesis (DDS)
ad9910
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DXXCCN
时钟与DDS
Started
1 month ago
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DDS AD9910
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你好,我使用AD9910进行多片同步,采用ADCLK854进行时钟分配,采用D触发器进行同步触发,系统采用40MHz晶振进行提供,通过分配器分发给9910,现在波形输出正常,有62.5MHz的同步信号输出,SYNC-CLK有250MHz的波形输出,但是一直显示未收到有效信号,同步引脚一直为高,请问我要怎么解决?
Datasheet/Specs
hardware
clock and timing
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Direct Digital Synthesis (DDS)
ad9910
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QingGuang233
时钟与DDS
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1 month ago
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Echen5
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ad9528/ad9510测试板
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我需要对ad9528/ad9510进行初步测试,ad9528只需要测试其pll2和时钟分配功能,ad9510只需要测试其时钟分配功能,具体原理图如图 假设其余元件(有源晶振和电源)工作良好,这个测试板是否有致命缺陷?因为在尝试焊接后接电,ad9528出现明显发热到40+℃的情况,我想排除原理图问题
Clock Generation Devices
Clock Generation and Distribution
ad9528
ad9510
schematic
test borad
short circult
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cp3kuo
时钟与DDS
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1 month ago
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Echen5
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时钟管理芯片AD9517-4使用咨询
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请教AD9517-4使用问题: AD9517-4的out4~7即可以配置成lvds输出,也可以配置成cmos输出; 我在使用时,可以把out4与out5配置为lvd输出,另把out6与out7配置为cmos输出吗? 感谢~
Clock Generation and Distribution
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oldeng
时钟与DDS
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1 month ago
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oldeng
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ad9528 spi not respone
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I have design a pcb use ad9528 to generate jesd204b clock for adrv9009. the schemtic is basiclly same as zcu102 and adrv9009 eval board. I try NO-OS sample of ADRV9009 .It exited at read device id . I have check the spi signal sended by xczu15eg...
Clock Generation Devices
Clock Generation and Distribution
hardware
ad9528
Wideband Transceiver IC
RF Integrated Transceivers
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Bing2510
时钟与DDS
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2 months ago
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Bing2510
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AD9548 的参考输入REFA 单端输入的功率大小?8dBm 的10MHZ 信号可以吗
0
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AD9548 的参考输入REFA 单端输入的功率大小?8dBm 的10MHZ 信号可以吗
Clock Generation and Distribution
Clock Synchronization
Clocks & Timers
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Jesse__S
时钟与DDS
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11 days ago
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Jesse__S
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使用AD9954/3/2/1的ASF调节输出波形幅值时,会影响DAC的输出位数吗?
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AD9954/ AD9953/AD9952/AD9951 有一个ASF(Amplitude scale factor)的14bit寄存器,可以调节输出波形的幅值,这里的幅值调节是否对AD9954内部14bitDAC的输出位数产生影响,是否还能保证在ASF修改为任意值时,DAC的输出位数都是14bit。如果修改ASF会影响DAC输出位数,那么有没有其他调节输出波形幅值的方法?
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SGSD
时钟与DDS
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14 days ago
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YANAMIANNA
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AD9910
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我设计的ad9910电路板,放在机箱中机箱模块5v供电,机箱收到静电时ad9910的输出会归零,通过spi读取寄存器,静电后cfr1,cfr2,cfr3这三个寄存器复位成默认值,其他step,range等寄存器保持不变。重新配置寄存器,ad9910输出恢复,我想知道静电影响了芯片的哪个位置或者引脚让cfr寄存器复位
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oldeng
时钟与DDS
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1 month ago
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oldeng
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ad9528 spi not respone
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I have design a pcb use ad9528 to generate jesd204b clock for adrv9009. the schemtic is basiclly same as zcu102 and adrv9009 eval board. I try NO-OS sample of ADRV9009 .It exited at read device id . I have check the spi signal sended by xczu15eg...
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ad9528
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cp3kuo
时钟与DDS
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1 month ago
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Echen5
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时钟管理芯片AD9517-4使用咨询
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请教AD9517-4使用问题: AD9517-4的out4~7即可以配置成lvds输出,也可以配置成cmos输出; 我在使用时,可以把out4与out5配置为lvd输出,另把out6与out7配置为cmos输出吗? 感谢~
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Bing2510
时钟与DDS
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2 months ago
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Bing2510
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AD9548 的参考输入REFA 单端输入的功率大小?8dBm 的10MHZ 信号可以吗
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AD9548 的参考输入REFA 单端输入的功率大小?8dBm 的10MHZ 信号可以吗
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Clock Synchronization
Clocks & Timers
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QingGuang233
时钟与DDS
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2 months ago
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Echen5
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AD9528 NVM
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AD9528里有FLASH或者ROM能保存所有的寄存器设置吗?
Clock Generation Devices
Clock Generation and Distribution
flash
ad9528
nvm
rom
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yyz1988
时钟与DDS
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3 months ago
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YANAMIANNA
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AD9954可以设置成突发模式吗
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想让AD9954输出一个突发波形,频率20M,通过一个引脚触发输出连续100个时钟周期的正弦波后就停止输出,如何设置呢,如果不能设置,有没有其他可以用的DDS芯片来实现这个功能呢,谢谢 I want AD9954 to output a burst waveform with a frequency of 20M. After triggering through a pin,it will output a sine wave for 100 consecutive clock cycles...
ad9954
Datasheet/Specs
clock and timing
Clocks & Timers
Direct Digital Synthesis (DDS)
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chenfei123
时钟与DDS
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3 months ago
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Echen5
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AD9912 输出杂散问题
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我在使用AD9912时遇到输出杂散的问题:我给AD9912的输入参考时钟为1GHZ,器件disable时钟PLL功能,配置输出单频信号,例如手册中的201.1Mhz时从频谱仪上看500Khz窄带宽内杂散很少,并且幅度很小,SFDR能做到-90dbc。但是配置其它频点,例如200.001Mhz时,在500khz窄带宽内增加了很多杂散信号,SFDR只有-70dbc,这与手册中的指标相比差了很多,并且这些杂散均匀分布,各杂散频率间隔5khz,我不太清楚这是什么原因导致的。我试了很多输出频点,有一些频点信号窄带SFDR很好...
hardware
clock and timing
ad9912
Clocks & Timers
Direct Digital Synthesis (DDS)
杂散
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JiangningDistrictNanjingCityJiangsuProvince
时钟与DDS
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4 months ago
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ADIApproved
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AD9910的同步差分输入,同步差分输出和16路并且信号输入的问题
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你好, 想问下几个小问题,谢谢 1.AD9910的 SYNC_IN+、SYNC_IN-这2个LVDS输入时钟是否可以和FPGA的HP bank(1.8V供电)输出的LVDS时钟相连吗? 2.AD9910的SYNC_OUT+、SYNC_OUT-这2个LVDS输出时钟是否可以由FPGA的HP bank(1.8V供电)接受吗? 3.AD9910的D0~D15这16个LVDS输入信号是否可以和FPGA的HP bank(1.8V供电)输出的LVDS信号相连吗?
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clock and timing
Clocks & Timers
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JiangningDistrictNanjingCityJiangsuProvince
时钟与DDS
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5 months ago
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Echen5
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ADCLK925的输出问题
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你好, 规格书中如下的输出波形的测试条件中有条就是端接50ohm的电阻到1.3V,想问下这个 端接50ohm的电阻到1.3V的电路是芯片本身自带的,还是需要使用者自己添加到芯片外围电路中的呢?
179
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